vista에서quartus 그 18
개요
vista에서 quartus 해 보았다.
polyphony로 serial 해 보았다.
zundoko 해 보았습니다.
환경
windows vista 32bit
quartus ii v13.0
polyphony v0.3.6
ep2c5t144 보드
사진


샘플 코드
from polyphony import testbench, module, is_worker_running
from polyphony.timing import clksleep
from polyphony.io import Port
from polyphony.typing import bit, uint8
@module
class zundoko:
def __init__(self):
self.data = Port(uint8, 'out', init = 0)
self.start = Port(bit, 'out', init = 0)
self.append_worker(self.worker)
def _wait(self):
for i in range(100000):
pass
def send(self, c:uint8):
self.data(c);
self.start(1)
clksleep(1)
self.start(0)
self._wait()
def worker(self):
i:uint8 = 0
n:uint8 = 0
r:uint8 = 234
while is_worker_running():
if (i < 1):
if (n < 4):
r = r * 5 + 1
if (r < 127):
print("zun")
self.send(122)
self.send(117)
self.send(110)
self.send(32)
n = n + 1
else:
print("doko");
self.send(100)
self.send(111)
self.send(107)
self.send(111)
self.send(32)
n = 0
else:
print("doko kiyosi!!")
self.send(100)
self.send(111)
self.send(107)
self.send(111)
self.send(32)
self.send(107)
self.send(105)
self.send(121)
self.send(111)
self.send(115)
self.send(105)
self.send(33)
self.send(33)
i = i + 1
m = zundoko()
verilog 코드
module test2(input clk, input rst, output tx);
wire [7:0] data;
wire start;
tx2 tx2(.clk(clk), .rst(rst), .start(start), .data(data), .tx(tx), .busy(busy), .get(get));
zundoko_m m(.clk(clk), .rst(rst), .data(data), .start(start));
endmodule
이상.
Reference
이 문제에 관하여(vista에서quartus 그 18), 우리는 이곳에서 더 많은 자료를 발견하고 링크를 클릭하여 보았다
https://qiita.com/ohisama@github/items/620b781e7e7d8670f940
텍스트를 자유롭게 공유하거나 복사할 수 있습니다.하지만 이 문서의 URL은 참조 URL로 남겨 두십시오.
우수한 개발자 콘텐츠 발견에 전념
(Collection and Share based on the CC Protocol.)
windows vista 32bit
quartus ii v13.0
polyphony v0.3.6
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사진


샘플 코드
from polyphony import testbench, module, is_worker_running
from polyphony.timing import clksleep
from polyphony.io import Port
from polyphony.typing import bit, uint8
@module
class zundoko:
def __init__(self):
self.data = Port(uint8, 'out', init = 0)
self.start = Port(bit, 'out', init = 0)
self.append_worker(self.worker)
def _wait(self):
for i in range(100000):
pass
def send(self, c:uint8):
self.data(c);
self.start(1)
clksleep(1)
self.start(0)
self._wait()
def worker(self):
i:uint8 = 0
n:uint8 = 0
r:uint8 = 234
while is_worker_running():
if (i < 1):
if (n < 4):
r = r * 5 + 1
if (r < 127):
print("zun")
self.send(122)
self.send(117)
self.send(110)
self.send(32)
n = n + 1
else:
print("doko");
self.send(100)
self.send(111)
self.send(107)
self.send(111)
self.send(32)
n = 0
else:
print("doko kiyosi!!")
self.send(100)
self.send(111)
self.send(107)
self.send(111)
self.send(32)
self.send(107)
self.send(105)
self.send(121)
self.send(111)
self.send(115)
self.send(105)
self.send(33)
self.send(33)
i = i + 1
m = zundoko()
verilog 코드
module test2(input clk, input rst, output tx);
wire [7:0] data;
wire start;
tx2 tx2(.clk(clk), .rst(rst), .start(start), .data(data), .tx(tx), .busy(busy), .get(get));
zundoko_m m(.clk(clk), .rst(rst), .data(data), .start(start));
endmodule
이상.
Reference
이 문제에 관하여(vista에서quartus 그 18), 우리는 이곳에서 더 많은 자료를 발견하고 링크를 클릭하여 보았다
https://qiita.com/ohisama@github/items/620b781e7e7d8670f940
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from polyphony.timing import clksleep
from polyphony.io import Port
from polyphony.typing import bit, uint8
@module
class zundoko:
def __init__(self):
self.data = Port(uint8, 'out', init = 0)
self.start = Port(bit, 'out', init = 0)
self.append_worker(self.worker)
def _wait(self):
for i in range(100000):
pass
def send(self, c:uint8):
self.data(c);
self.start(1)
clksleep(1)
self.start(0)
self._wait()
def worker(self):
i:uint8 = 0
n:uint8 = 0
r:uint8 = 234
while is_worker_running():
if (i < 1):
if (n < 4):
r = r * 5 + 1
if (r < 127):
print("zun")
self.send(122)
self.send(117)
self.send(110)
self.send(32)
n = n + 1
else:
print("doko");
self.send(100)
self.send(111)
self.send(107)
self.send(111)
self.send(32)
n = 0
else:
print("doko kiyosi!!")
self.send(100)
self.send(111)
self.send(107)
self.send(111)
self.send(32)
self.send(107)
self.send(105)
self.send(121)
self.send(111)
self.send(115)
self.send(105)
self.send(33)
self.send(33)
i = i + 1
m = zundoko()
verilog 코드
module test2(input clk, input rst, output tx);
wire [7:0] data;
wire start;
tx2 tx2(.clk(clk), .rst(rst), .start(start), .data(data), .tx(tx), .busy(busy), .get(get));
zundoko_m m(.clk(clk), .rst(rst), .data(data), .start(start));
endmodule
이상.
Reference
이 문제에 관하여(vista에서quartus 그 18), 우리는 이곳에서 더 많은 자료를 발견하고 링크를 클릭하여 보았다
https://qiita.com/ohisama@github/items/620b781e7e7d8670f940
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우수한 개발자 콘텐츠 발견에 전념
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module test2(input clk, input rst, output tx);
wire [7:0] data;
wire start;
tx2 tx2(.clk(clk), .rst(rst), .start(start), .data(data), .tx(tx), .busy(busy), .get(get));
zundoko_m m(.clk(clk), .rst(rst), .data(data), .start(start));
endmodule
Reference
이 문제에 관하여(vista에서quartus 그 18), 우리는 이곳에서 더 많은 자료를 발견하고 링크를 클릭하여 보았다 https://qiita.com/ohisama@github/items/620b781e7e7d8670f940텍스트를 자유롭게 공유하거나 복사할 수 있습니다.하지만 이 문서의 URL은 참조 URL로 남겨 두십시오.
우수한 개발자 콘텐츠 발견에 전념
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